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在理想情况下,从数字上变频器(DUC)(通过数字预失真)到DAC乃至通过功率倍增器的路径将没有带宽限制。同样地,观测路径上的ADC将对全带宽进行数字化。请注意,为了进行说明,我们扩展2倍带宽的信号路径;在某些无线蜂窝应用中,可扩展到3至5倍的带宽。理想方案是通过数字预失真产生带内项和带外项,从而完全消除功率放大器引入的失真。需要注意的是,为了准确消除失真,需要在目标信号的带宽之外创建项,这一点非常重要。在实际方案中,信号路径具有带宽限制和倾斜特性,数字预失真性能无法达到理想方案要求。
一个完全实时、闭环、自适应电缆数字预失真解决方案,由FPGA结构中的执行器和嵌入式处理器中基于软件的自适应机制组成。该实现方案使用Intel® Arria® 10 660 FPGA和嵌入式ARM® Cortex®处理器。DPD IP内核和ARM的功耗为5.3 W,尽管使用更新一代的FPGA或转换为ASIC,此功率仍应低于3 W。
Hubbell, P200NGY
1922V484
SP400A-R2
SA53RCUL, SA53RCUL20
LRD21
Allen Bradley, 1492-G025
SMC, CDQ2B40-50DM
Eaton, C25DND330T
Sumitomo, HTAC62601, MWTA045, CS3000
Yaskawa JZRCR-XFL03-1 PC CBL-RC036-2
Parker B5E2ACB53C
Allen Bradley, 1492-CB2F030
Koganei, MR050
Allen Bradley, OA27
Phd, 17524
Moeller, Z00-1.6
Festo, 30459, 131131-1, SMEO-1-LED-24-B
Omron, E2E-X20MD1
Omron, E2K-X8ME1
Omron, H3BH-8